TMS320C5517低功耗C55x定点DSP - 高达200MHz、USB、LCD接口、FFT HWA、SAR ADC Texas Instruments德州仪器TI

此器件基于TMS320C55x DSP生成CPU处理器内核。 C55x DSP 架构通过增加的并行性和重视节能来实现高性能和低功耗。 CPU 支持一个内部总线结构，此结构包含一条程序总线，一条 32 位读取总线和两条 16 位数据读取总线，两条数据写入总线和专门用于外设和 DMA 操作的附加总线。

这些总线可实现在一个单周期内执行高达四次 16 位数据读取和两次 16 位数据写入的功能。 此器件还包含四个 DMA 控制器，每个控制器具有 4 条通道，可在无需 CPU 干预的情况下提供 16 条独立通道的数据传送。

每个 DMA 控制器在每周期可执行一个 32 位数据传输，此数据传输与 CPU 的运行并行并且不受 CPU 运行的影响。

C55x CPU 提供两个乘积累积 (MAC) 单元，每个单元在一个单周期内能够进行 17 位乘以 17 位乘法以及 32 位加法。 一个中央 40 位算术和逻辑单元 (ALU) 由一个附加 16 位 ALU 提供支持。

ALU 的使用受指令集控制，从而提供优化并行运行和功耗的能力。 C55x CPU 内的地址单元 (AU) 和数据单元 (DU) 对这些资源进行管理。

C55x CPU 支持一个可变字节宽度指令集以改进代码密度。 指令单元 (IU) 执行从内部或外部存储器中的 32 位程序取指令并且进行针对程序单元 (PU) 的指令排队。

PU 对指令进行解码，将任务指向地址单元和数据单元资源，并管理受到完全保护的管线。 跳转预测功能避免了条件指令执行时的管线冲刷。

GPIO 功能与 10 位 SAR ADC 一起为状态、中断以及用于键盘和媒体接口的位 I/O 提供足够的引脚。

通过以下器件为串行媒体提供支持：两个多媒体卡和安全数字（MMC 和 SD）外设、三个内部 IC 声音（I2S 总线）模块、一个具有四芯片选择的串行端口接口 (SPI)、一个具有三芯片选择主控和受控多通道经缓冲串行端口接口 (McSPI)、一个多通道串行端口 (McBSP)、一个 I2C 多主控和受控接口以及一个通用异步收发器 (UART) 接口

该器件的外设集包括一个外部存储器接口 (EMIF)，此接口提供到异步存储器的无缝访问，例如 EPROM，NOR，NAND 和 SRAM，以及高速、高密度存储器，例如同步 DRAM (SDRAM) 和移动 SDRAM (mSDRAM)。

其它外设包括：一个可配置 16 位通用主机端口接口 (UHPI)、一条仅支持器件模式的高速通用串行总线 (USB2.0)、一个实时时钟 (RTC)、三个通用定时器（其中一个可配置为看门狗定时器）和一个模拟锁相环 (APLL) 时钟发生器。

器件还包含一个紧密耦合 FFT 硬件加速器 - 支持 8 至 1024 点（2 的次幂）实值和复值 FFT，三个集成低压降稳压器 (LDO) - 为器件的各部分供电（需要外部电源的 CVDDRTC 除外）：ANA_LDO 为 SAR 和电源管理电路 (VDDA_ANA) 提供 1.3V 电压，DSP_LDO 为 DSP 内核 (CVDD)（一旦检测到工作频率范围，便可由软件实时进行选择）提供 1.3V 或 1.05V 电压，USB_LDO 为 USB 内核数字电路 (USB_VDD1P3) 和 PHY 电路 (USB_VDDA1P3) 提供 1.3V 电压。