LMK03318具有单个PLL的超低抖动时钟发生器系列 Texas Instruments德州仪器TI

LMK03318 是一款超低噪声 PLLATINUM™时钟发生器，具有一个带集成式 VCO、灵活时钟分配和扇出的分数 N 频率合成器，在片上 EEPROM 中存储有引脚可选配置状态。该器件可为各种千兆位级串行接口和数字器件提供多个时钟，从而通过替代多个振荡器和时钟分配器件来降低物料清单 (BOM) 成本、减小电路板面积、以及提高可靠性。超低抖动可降低高速串行链路中的比特误码率 (BER)。

对于 PLL，可以选择差分时钟、单端时钟或晶振输入作为参考时钟。所选基准输入可用于将 VCO 频率锁定在基准输入频率的整数或小数倍。VCO 频率可在 4.8GHz 至 5.4GHz 范围内进行调整。凭借 PLL，用户可以根据应用需求灵活选择预定义或用户定义的环路带宽。PLL 有一个后分频器，分频选项包括 2 分频、3 分频、4 分频、5 分频、6 分频、7 分频或 8 分频。

所有输出通道均可选择经过 PLL 分频的 VCO 时钟作为输出驱动器的时钟源，从而设置最终输出频率。部分输出通道还可以单独选择 PLL 的基准输入作为将旁路到相应输出缓冲器的备用时钟源。8 位输出分频器支持 1 至 256（偶数或奇数）的分频范围，输出频率高达 1GHz，并且具有输出相位同步功能。

所有输出对均为以地为基准并具有可编程摆幅的 CML 驱动器，并且可通过交流耦合方式连接到 LVDS、LVPECL 或 CML 接收器。另外，所有输出对还可以单独配置为 HCSL 输出或 2 x 1.8V LVCMOS 输出。与以电压为基准的驱动器设计（例如，传统的 LVDS 和 LVPECL 驱动器）相比，该输出具有更低的功耗（1.8V 时）、更出色的性能和电源抗扰度、以及更少的电磁干扰 (EMI)。通过 STATUS 引脚可获得两个额外的 3.3V LVCMOS 输出。这是一项可选特性，可在需要 3.3V LVCMOS 输出及不需要器件状态信号时使用。